Chipsalliance

Rocketchip

1 Schwachstelle gefunden

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Exploit
  • EPSS 0.04%
  • Veröffentlicht 10.11.2025 20:15:49
  • Zuletzt bearbeitet 05.02.2026 15:25:19

A vulnerability was discovered in RISC-V Rocket-Chip v1.6 and before implementation where the SRET (Supervisor-mode Exception Return) instruction fails to correctly transition the processor's privilege level. Instead of downgrading from Machine-mode ...